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zoom RSS テーマ「SPARC」のブログ記事

みんなの「SPARC」ブログ

タイトル 日 時
OracleのローコストSPARCプロセッサSonoma
 Oracleがローコスト版SPARC(コードネーム Sonoma)を開発中、2015/8月末のHotChipsで発表するとのこと。 現行のOracle SPARCが持つ暗号化やデータベースサポートの機能を下方展開。Intel Xeonと同価格帯にするということだ。10進浮動小数点演算はサポートするのかな?  Oracle/富士通はIBMのPOWERと同じくハイエンド側に振り切ったままと思っていた。が、それだとなかなかユーザーも広がらないのでという考えなのだろうか。 ...続きを見る

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2015/08/01 03:14
64bit SPARCアーキテクチャの進化
 富士通からSPARC64X/X+の資料が公開された。 アプリケーション開発者向け資料 SPARC64 X / X+ Specification (2015年3月/ 3.0MB/ 英語)  これを読む前に、64bitのSPARC V9アーキテクチャ以降を整理した。 ...続きを見る

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2015/03/26 07:54
レジスタウィンドウ
 現行のプロセッサで汎用レジスタの本数が多いのはIA-64?いえSPARCです。 ...続きを見る

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2012/01/07 15:57
AWKによるSPARC V8逆アセンブラ
 Aho、Weinberger、Kernighan著の「プログラミング言語AWK」復刊(/.J)  トッパンから初版が出た時には大学生協でA君と奪い合ったなあ。スラッシュドットジャパンでも活発に議論されてるみたいだが、自分がオッサンだと自白するようなものか?  ハード設計でも役に立って、CADのデータ加工などに活躍しました。それまではみな印刷して手作業でチェックしていたので布教してまわったものです。しかし新人の私に結局は仕事が振られるという。  昔作った、AWKで書いたSPARC V8用の... ...続きを見る

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2010/01/07 10:09
マルチメディア命令調査:UltraSPARCのVIS命令 その2
SPARCのVIS命令続き。 ...続きを見る

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2009/12/25 03:33
マルチメディア命令調査:UltraSPARCのVIS命令 その1
・VIS(Visual Instruction Set) SPARC V9では定義されていない。Sun UltraSPARC独自の追加仕様。 ・UltraSPARC I,IIはVIS IのみだったがUltraSPARC IIIでVIS IIが追加定義された。 ・富士通のSPARC64は後にSunと共同で定義したJPS1という仕様書でUltraSPARCと共通化された。 ・GSR(Graphic Status Register)というステータスレジスタを使用。 ・FSR(Floating ... ...続きを見る

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2009/12/15 19:37
Rad Hard 耐放射線 SPARC V8 について
 最初に知ったのは以下のページから。ちょっと興味を持ったので調べてみた。 ・耐放射線SPARCプロセッサ (佐藤研究室のHPにようこそ!) ・宇宙向けに対放射線強化が施されたSPARC V8 プロセッサ登場 (/.J)  同業他社のSさんと飲みながら話をしたときのこと。昔はアルファ線源によるソフトエラー発生のテストをやっていたのだが、今はLSIが微細化されて中性子でソフトエラーが発生するそうだ。高地ほど中性子線エラーが発生しやすいということだ。地上勤務の私はソフトエラーに出くわしたことがな... ...続きを見る

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2009/08/01 08:42
SPARC64 VIIIfxの浮動小数点レジスタ拡張について
 SPARC64 VIIIfxのHPC-ACE拡張について。浮動小数点レジスタは倍精度で256本ある。SPARCは32ビット長の単精度レジスタを1本と数え、64ビット長の倍精度レジスタは偶数番号から数える。よって浮動小数点レジスタはf[0]からf[511]まで存在する。  倍精度レジスタの単精度利用というのがある。これはf[0],f[2],...f[510]の64ビット長256本の倍精度レジスタに対し、偶数番号側32ビットを単精度として利用し、奇数番号側32ビットは0となる。 f[0]-f[... ...続きを見る

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2009/06/07 00:24
SPARCの浮動小数点レジスタについて
 SPARCの浮動小数点レジスタはちょっと変わっている。  他のプロセッサは、64ビット長のレジスタ(MIPS,POWER ISA2.04)または80ビット長のレジスタ(IA-64,IA-32)1本で倍精度、単精度の数値を扱っている。  MIPS I では2本の32ビット単精度レジスタを組み合わせて1本の倍精度レジスタとして扱っていたが、MIPS III では1本のレジスタを64ビットに拡張した。  SPARCは、32ビット長のレジスタを基本に64本持っており、先頭から数えて32本を単精度... ...続きを見る

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2009/06/03 22:40
富士通CPU「Venus」の紹介のされ方
 富士通が最速CPU開発、10年ぶり日本メーカー首位(YOMIURI ONLINE) 一般のニュースで取り上げられたのが5月13日。これは他のIT系ニュースサイトよりも早かった。 これに関しては富士通が世界最速となるCPU「Venus」を開発、処理速度はIntelの最速モデルの2.5倍(Gigazine) がそのまま紹介している。 では気付いた点を検証していこう。 ・「1秒間に1280億回の計算ができる世界最速のCPU」→これは128GFlopsのことか? ・「計算速度はIntel製CP... ...続きを見る

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2009/05/14 17:55
SPARCのメモリオーダリング
SPARCのメモリオーダリング  例えばサイクル数のかかる除算命令の結果をストアした後で、次の計算のためのデータをロードするとしよう。このストアするデータの場所とロードするデータの場所は別々の場所だとする。つまり、依存関係はない。  通常のプログラム実行順序だとストアが完了しなければロードを始めることができない。もしアウトオブオーダー実行のプロセッサで後続のロード命令を先行させても、この順序では追い越すことができず、性能を発揮できない。アウトオブオーダーでも命令実行完了時は命令の発行順序を守らなければならないからだ。  こ... ...続きを見る

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2009/05/03 22:58
生き残ったMIPS,SPARC
 MIPSもSPARCも第一世代のRISCである。MIPSはRISCの基本であり、SPARCはレジスタウィンドウという物理的にサイズが大きくなってしまう仕組みを持っていた。これはコンパイラ支援の機能であり、分岐命令のアナルビットも同じような目的で存在する。  このためSPARCはMIPSと較べサイズが大きくなり、組み込み系には向かなかった。SPARCliteというチップが富士通から出ているがMIPSより使われているとは思えないし、32bitプロセッサであり64bitプロセッサのR4000系に負... ...続きを見る

なるほど(納得、参考になった、ヘー) ブログ気持玉 2 / トラックバック 0 / コメント 0

2009/04/26 07:27
HPC-ACE SPARC64 VIIIfxについて
Ando's Processor Information Pageで知った、 最近の話題 2009年3月14日 1.富士通のHPC-ACEアーキテクチャとPowerISA V2.06よりSPARC64VIIIfxのドキュメントを読んでみた。これらのドキュメントは以下からダウンロードできる。 ...続きを見る

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2009/03/16 11:21
OpenSPARC T2 リリース
OpenSPARC.net サン、「Niagara 2」のオープンソース提供を開始(CNET JAPAN) サン、64スレッドCPU「T2」をオープンソース化(@IT) ...続きを見る

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2007/12/12 22:27
浮動小数点演算に関する比較
徹底解説 - POWERアーキテクチャ2.03(MYCOMジャーナル 安藤壽茂) http://journal.mycom.co.jp/articles/2007/02/12/powerisa/ を読んで、各種プロセッサの浮動小数点演算を比較してみようと思った。 ...続きを見る

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2007/02/18 23:18
SPARCアーキテクチャのリソース
- SPARC V8/V9アーキテクチャのマニュアルがダウンロードできる。 SPARC International Inc. http://www.sparc.org/ ...続きを見る

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2006/05/25 23:07

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